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big.LITTLE

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big.LITTLE (de l'anglais big signifiant « grand » et little signifiant « petit ») est une technologie de microprocesseur multi-cœur conçue par ARM, utilisant simultanément un cœur à très faible consommation (LITTLE) comme cœur principal et plusieurs cœurs plus puissants (big), s'activant en cas de demande importante en puissance de calcul. Cela permet d'économiser davantage d'énergie que lorsque plusieurs processeurs de même puissance sont mis en parallèle, tout en conservant une forte capacité de calcul.

Cette technologie est utilisée pour la première fois avec la 3e génération des processeurs de la famille ARM Cortex-A. Les ARM Cortex-A7 sont les LITTLE, tandis que les ARM Cortex-A15 MPCore ou ARM Cortex-A17 MPCore sont les big. Les différents processeurs sont connectés via un ensemble de deux systèmes de bus appelé CoreLink 400 ; la technologie CCI-400 (Cache coherent interconnect for accelerators) permettant également d'échanger les données avec les autres processeurs (GPU, VPU (en), DSP…) et la mémoire et le GIC-400 (Generic Interrupt Controller), programmable, permettant de distribuer jusqu'à 480 interruptions sur les différents processeurs[1]. Le cœur ARM Cortex-A17, présenté en , aussi puissant que le Cortex-A15 mais plus économe en énergie[2], pourra également jouer le rôle de big dans ce type d'architecture.

Modes de fonctionnement

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Différents modes de fonctionnement ont été introduits sous le noyau Linux par Linaro en . Un ou plusieurs des cœurs Cortex-A7 peuvent travailler lorsque la charge est faible, tandis que les A12 ou A15 prendront le relais (mode IKS – In Kernel Switcher, signifiant en anglais « Commutation dans le noyau ») ou s'y ajouteront (mode GTS – Global Task Scheduling, signifiant « ordonnancement global des tâches »)[3] lorsque l'utilisation le nécessitera.

La nouvelle génération 64 bits d'ARM (uniquement des FPGA X-Gene en 2013), nommée ARM Cortex-A50 autorise aussi cette technologie, mais avec un meilleur rendement. l'ARM Cortex-A53 sera le LITTLE et l'ARM Cortex-A57 le big. Une nouvelle version du bus, nommé CoreLink 500 permet de joindre jusqu'à 4 processeurs LITTLE et jusqu'à 16 processeurs big dans différentes combinaisons selon le type de plateforme ciblée (smartphone basse consommation, smartphone plus puissant, tablette ou serveur[4]).

En mai 2017, ARM a annoncé DynamIQ comme successeur de big.LITTLE[5]. DynamIQ devrait permettre plus de flexibilité et d’évolutivité lors de la conception de processeurs multicœurs. Contrairement à big.LITTLE, il augmente le nombre maximal de cœurs dans un cluster à 8 pour les processeurs ARMv8.2, 12 pour ARMv9 et 14 pour ARMv9.2[6] et permet différentes conceptions de cœurs au sein d’un seul cluster, jusqu’à 32 clusters au total. La technologie offre également un contrôle de tension plus précis par cœur et des vitesses de cache L2 plus rapides. Cependant, DynamIQ est incompatible avec les conceptions ARM précédentes et est initialement uniquement pris en charge par les cœurs CPU Cortex-A75 et Cortex-A55 ainsi que leurs successeurs.

Notes et références

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  1. (en) Big.LITTLE Processing with ARM CortexTM-A15 & Cortex-A7 sur ARM.com
  2. (en) ARM Cortex A17: An Evolved Cortex A12 for the Mainstream in 2015 sur anandtech.com.
  3. (en) big.LITTLE Software Update, le 10 juillet 2013, sur Linaro.org
  4. (en) ARM Launches Cortex-A50 Series, the World’s Most Energy-Efficient 64-bit Processors sur arm.com
  5. (en-US) Matt Humrick, « Exploring Dynamiq and ARM's New CPUs (archivé depuis l'original) », Anandtech, (consulté le )
  6. (en) Arm Ltd, « DynamIQ – Arm® », sur Arm | The Architecture for the Digital World (consulté le )

Articles connexes

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Liens externes

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