Datei:SPI timing diagram CS.svg
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Beschreibung
| Beschreibung |
English: SPI timing diagram showing clock polarity and phase. Blue lines indicate clock cycle boundaries when CPHA=0. Red lines indicate clock cycle boundaries when CPHA=1. |
| Datum | |
| Quelle | File:SPI_timing_diagram.svg |
| Urheber | User:Cburnett |
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GFDL |
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| Version vom | Vorschaubild | Maße | Benutzer | Kommentar | |
|---|---|---|---|---|---|
| aktuell | 23:55, 2. Aug. 2023 | | 330 × 190 (153 KB) | Em3rgent0rdr | colored the MISO and MOSI numbered bit signals |
| 01:26, 23. Jul. 2023 |  | 330 × 190 (153 KB) | Em3rgent0rdr | swapping number ordering, to start with 7 down to 0, cause is typically MSB-first | |
| 18:24, 22. Jul. 2023 |  | 330 × 190 (152 KB) | Em3rgent0rdr | I got CPOL reversed...fixed | |
| 18:22, 22. Jul. 2023 |  | 330 × 190 (152 KB) | Em3rgent0rdr | added important CPOL=0 and CPOL=1 as subscripts to SCLK | |
| 17:54, 22. Jul. 2023 |  | 330 × 200 (151 KB) | Em3rgent0rdr | Uploaded a work by User:Cburnett from https://commons.wikimedia.org/wiki/File:SPI_timing_diagram.svg with UploadWizard |
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